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主题: CPU缓存技术项目讨论——合作伙伴哪里找？

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CPU缓存技术项目讨论——合作伙伴哪里找？

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CPU缓存技术项目讨论——合作伙伴哪里找？ -- tutu - (1687 Byte) 2010-10-16 周六, 13:09 (3860 reads)

SBYY

头衔: 海归中尉
声望: 学员

加入时间: 2010/04/14
文章: 74

海归分: 4606

标题: 忽然看到一篇多年前的文章，颇有感触 (449 reads) 时间: 2010-10-17 周日, 12:42

作者：SBYY 在项目找投资与合作发贴, 来自【海归网】 http://www.haiguinet.com

高性能汉芯系列

汉芯二号、三号是上海交通大学继“汉芯一号”之后的又两个重大科研成果。“汉芯二号、三号”高性能DSP芯片作为汉芯家族的新成员，在性能和开发支持等方面又有了较大的发展。汉芯二号24位DSP芯片采用0.15~0.18微米半导体工艺设计，具有每秒1.5亿次指令的运算速度和150Mhz的时钟主频。国家863计划的重点项目“汉芯三号---32位DSP芯片”，主频达到300MHz/600MIPs，采用低功耗设计方法，平均功耗仅为30mw/100MHz，已超出国家863原定的性能要求。专家一致认为，汉芯三号芯片达到了国际著名公司同类产品的先进水平，是我国高性能、低功耗32位DSP芯片研究的重大突破。

核心技术和创新点

汉芯系列DSP共申请12项专利和一项布图保护，创新点包括支持多字指令格式，片上存储器和Cache是可切换结构，Cache容量可重构，快速响应中断结构，独特的可嵌套硬LOOP结构可加快算法速度，提供多种低功耗工作方式。汉芯系列DSP和国外同类产品相比，性能处于国内领先、国际先进水平，但价格远低于国外产品，良好的性价比将在信息家电、音频处理、多媒体通信等领域大显身手。其他主要创新点有：

（1）多级灵活Cache结构为了平衡处理器和存储器之间的速度差异，进一步降低DSP对存储器的访存压力，汉芯系列DSP芯片设计了高效灵活的 Cache结构，采用带有二级Cache的改进的哈佛结构，单周期能够执行多条指令。针对不同的设备应用，Cache的容量是可以动态调整，因此 Cache模块是十分灵活实用的。

（2）深度流水线结构汉芯系列DSP采用多级深度流水线结构，单周期并发多条指令，Load和Store在流水线的同一级执行，消除了读和写内存冲突。

（3）低功耗技术汉芯系列DSP在设计时已考虑到低功耗的需求，大量使用专门针对低功耗的VLSI设计方法，包括专门的低功耗标准元件库，低功耗为重要指标的电路综合流程，芯片等待停止模式的结构设计，和智能化电源管理电路等技术。除了正常工作模式外，DSP核还支持SLEEP和STOP两个更低功耗模式，最终使得处理器的功耗处于同类产品的领先水平。

（4）强大的配套应用开发环境软件部分共包括仿真器、调试器、汇编器和高级语言编译器，高级语言编译器可以提供用户简便的编程方式，同时在设计上如何设计编译优化算法是实现高效并行处理的关键所在。

作者：SBYY 在项目找投资与合作发贴, 来自【海归网】 http://www.haiguinet.com

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